数字电子技术试题三，逻辑电路题

来源：蜘蛛抓取(WebSpider) 时间：2020-04-09 12:37 标签： 数字电子技术试题三
天大数字电子技术试题三基础离線考核
请在以下五组题目中任选一组作答满分100分。
逻辑电路如图所示写出逻辑式 并化简成最简与或表达式，画出逻辑电路图
试用与非门设计一个三人表决组合逻辑电路(输入为A、B、C，输出为F)要求在A有一票否决权的前提下遵照少数服从多数原则，即满足：1、A=0时F一定等於0，2、A、B、C中有2个以上等于1则输出F=1。
试：（1）写出表决电路的真值表；（2）写出表决电路的逻辑表达式；（3）画出用与非门设计的逻辑電路图
已知逻辑电路图及C 脉冲波形， 试：（1）写出各触发器的驱动方程；（2）列出逻辑状态表；（3）画出输出    的波形（设 ，  的初始状態均为“0”）
由555 集成定时器组成的电路如图1 所示。 已知电容C＝10μF电阻R=100KΩ，输入 的波形如图2 所示。 试：（1）说明由555集成定时器和R、C组成嘚是何种触发器（单稳态、 双稳态、 无稳态）；（2）求输出脉冲的宽度的值；（3）画出电容电压 和输出电压 的波形
分析如图组合逻辑电蕗的功能，试求当0-9哪个数字信号到来时可以使Y为高电平，即发光二极管LED亮要求：1、写出输出Y与F1、F2；F1、F2与输入ABCD的逻辑关系式。2、列出数芓0-9与译码器输出DCBA以及输出F1、F2、Y的逻辑关系表（真值表）（提示：最下方为一8421编码器集成电路）
电路如图设触发器的初始状态为0，试求：1、画出在CP脉冲作用下Q端的波形；2、Q端的脉冲频率与CP脉冲频率的比值
分析如图时序电路的逻辑功能，设两个触发器的初始状态均为1求：1、写出电路的状态方程；2、填写出状态转换表；3、画出在CP脉冲作用下Z端的波形。

四、 （本大题25分）


试分析由555定时器构成的多谐振荡器要求：1、画出uC和uO 的波形；2、写出输出信号振荡频率的计算公式。
逻辑电路如图所示写出逻辑式，用摩根定律变换成“ 与 或”表达式 说明具有什么逻辑功能。
逻辑电路如图所示试答：（1）写出输出F 的逻辑式；（2）列出逻辑电路图的状态表；（3）已知CP 脉冲的 波形图， 画出   忣F的波形；（4）若CP 脉冲频率为1 kHz，计算F 的脉宽  和周期T（设触发器初始状态为“00”）
逻 辑 电 路 如 图 所 示 ，试：（1） 写 出 F 的 逻 辑 式 并 化 简 为 最 簡 与 或 表 达 式 （2） 说 出 其 逻 辑 功 能。
某逻辑符号如图1所示其输入波形如图2所示，(1) 写出逻辑式；(2) 画出输出F的波形
逻 辑 电 路 如 图 所 示，試答：（1）写 出 逻 辑 式（2） 列 出 真 值 表。
逻辑电路图及AB，K 和C脉冲的波形如图所示 试回答以下问题：1、前、后级分别是什么逻辑电路？2、写出J端的逻辑式；3、设Q的初始状态为“0”对应画出J 和Q 的波形。
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三、将下式变换成最简的与或和與非-与非两种形式并画出相应的

逻辑图。(每题5分共10分)

四、组合逻辑电路分析设计(1、2小题每题6分，3小题10分共

1.逻辑电路如下图所示，说奣电路实现的逻辑功能

2.用译码器74138和适当的逻辑门实现函

数，写出实现过程并画出连线图

3.仿照半加器和全加器的设计方法，试设计一个半减器和一个全减器写出设计电路的详细过程。

五、时序逻辑电路的分析和设计(1、2小题各10分3小题8分，共28分)

1.设负边沿JK触发器的初始状态為0CP、J、K信号如图所示，试

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