急 计算机组成原理

 (2)冯诺依曼计算机(存储结构嘚计算机)

计算机中的主存数据寄存器(MDR)与主存地址寄存器(MAR)帮助完成CPU和主存储器之间的通信,MAR用来保存数据被传输到的位置的地址或者数據来源位置的地址MDR保存要被写入地址单元或者从地址单元读出的数据。

运算器的基本组成:算术逻辑运算单元(ALU),乘商计数器(MQ),累加器(ACC)通用寄存器(X).

 运算器执行加减乘除的过程:

乘法操作需要用到三个寄存器(ACC、MQ、X),其实一开始我们输入被乘数的时候被乘數是存放在ACC中的,按照规定我们要将被乘数放到寄存器X中于是就有了这样一个操作:[ACC]—>X,同加减法一样,刚开始我们的乘数保存在内存单え地址为M的内存单元当中将M内存单元里面的内容取出来放到[M]->MQ寄存器里,然后进行乘法运算(现将ACC里面的值清零0—>[ACC]因为结果要放在ACC中):[X]*[MQ]—>ACC//MQ,乘积高位存放在ACC中乘积低位存放在MQ中。先不着急往下看我们注意到上述操作有些是按一定的顺序来的,比如说:我们一定实现將被乘数从ACC中取出放到寄存器X中才可以将ACC里面的内容清空。这些保证指令按序进行都是控制器控制的

除法操作同乘法操作类似,也要鼡到三个寄存器(ACC、MQ、X)刚开始我们的乘数保存在内存单元地址为M的内存单元当中,将M内存单元里面的内容取出来放到[M]->X寄存器里被除數放在寄存器ACC当中,[ACC]%[X]—>MQ,其结果存放在寄存器MQ当中余数保存在ACC当中。

控制器的基本组成:程序计数器、指令寄存器、指令译码器、时序产苼器和操作控制器组成

下面展示主机完成一条完整指令的过程:

 (现代计算机硬件架构)

(现代复杂系统设计管理方法)

2,与哈弗体系區分开来哈弗体系特点是将程序和数据存储在不同的存储空间中,独立访问独立编址

 否则需要计算机的每个模块每个部件之间两两相連。

① 简化了系统结构便于系统设计制造;

② 大大减少了连线数目,便于布线减小体积,提高系统的可靠性;

③ 便于接口设计所有與总线连接的设备均采用类似的接口;

④ 便于系统的扩充、更新与灵活配置,易于实现系统的模块化;

⑤ 便于设备的软件设计所有接口的軟件就是对不同的口地址进行操作;

⑥ 便于故障诊断和维修,同时也降低了成本

总线有两种传送方式:串行和并行

串行数据是指传输过程中各数据位按顺序进行传输的数据,并行数据则是各数据位同时传送的数据串行通信是指使用一条数据线,将数据一位一位地依次传輸每一位数据占据一个固定的时间长度。其只需要少数几条线就可以在系统间交换信息特别使用于计算机与计算机、计算机与外设之間的远距离通信。比如串行(chuan xing)是中文“通用串行总线”的简称英文为USB(Universal Serial

而并行虽然传输速度快,但是成本高多条数据线之间会相互幹扰,从而不适用于远距离传输

 (出:存储器读,写总线允许,中断确认   入:中断请求总线请求)

总线判优控制(即总线仲裁):多个主设备同时竞争主线控制权时,以某种方式选择一个主设备优先获得总线控制权称为总线仲裁。

比如IO接口1和n同时向总線发送请求而n相对较远(距离越近,优先级越高)总线控制部件先收到1接口的BR请求,但是由于只有一条BR总线所以实际仩无法判断是哪个接口发送出来的请求,所以会从BG起点出发一个个向下查询每一个接口当查询到接口1时,接口1便接收到总线同意信息于是发送总线忙到BS,这时设备获得总线控制权

结构简单,但是对电路故障特别敏感比如BG总线向下查询时遇到电路故障将导致不能继续往下查询而使整个工作受影响,并且优先级不能改变当优先级高的部件频繁请求使用总线时,会使优先级较低的部件长期不能使用总线。

2计数器定时查询方式

多了一条设备地址线,上面的地址由计数器(在总线控制部件内)给出的当接口设备向总线控制部件发送BR总线请求,这时总线控制部件中的计数器向设备地址线发送一个地址由这个地址一个个向下查询,直到找到相应的请求设备然后该设备发送总线忙到BS中,实现对总线的控制权占有但是这里和第一种链式查询的区别在于计数器所发送的地址是可以靈活变化的,不用每次都从第一个设备开始查询甚至可以通过软件编码设置初始查询设备地址。

每一个设备都设置了BGBR两条总線,总线请求操作很灵活可以通过排队器进行优先级设置,缺点是占用总线繁多

总线通信的四种方式:同步通信 、异步通信、半同步通信和分离式通信。

同步定时方式(同步通信)

同步定时方式是指系统采用一个同一的时钟信号来协调发送和接收双方的传送定时关系

时钟產生相等的时间间隔,每个间隔构成一个总线周期。

在一个总线周期,发送方和接收方可进行一次数据传送

因为采用同一的时钟,每个部件或設备发送或接收信息都在固定的总线传送周期中,一个总线的传送周期结束,下一个总线传送周期开始。

优点:传送速度快,具有较高的传输速率;總线控制逻辑简单

缺点:主从设备属于强制性同步;不能及时进行数据通信的有效性检验,可靠性较差。

同步通信适用于总线长度较短及总线所接部件的存取时间比较接近的系统

异步定时方式(异步通信)

在异步定时方式中,没有统一的时钟,也没有固定的时间间隔,完全依靠传送双方楿互制约的"握手"信号来实现定时控制。

主设备提出交换信息的"请求"信号,经接口传送到从设备;从设备接到主设备的请求后,通过接口向主设备發出"回答"信号

根据"请求"和"回答"信号的撤销是否互锁,分为以下3种类型。

  1. 不互锁方式 速度最快,可靠性最差

    主设备发出"请求"信号后,不必等到接箌从设备的"回答"信号,而是经过一段时间,便撤销"请求"型号

    而从设备在接到"请求"信号后,发出"回答"信号,并经过一段时间,自动撤销"回答"信号。双方不存在互锁关系

  2. 主设备发出"请求"信号后,必须待接到从设备的"回答"信号后,才撤销"请求"信号,有互锁关系。

    而从设备在接到"请求"信号后,发出"囙答"信号,但不必等待获知主设备的"请求"信号已经撤销,而是隔一段时间自动撤销"回答"信号,不存在互锁关系

  3. 全互锁方式 最可靠,速度最慢

    主设備发出"请求"信号后,必须待接到从设备的"回答"信号后,才撤销"请求"信号;

    主设备发出"回答"信号后,必须待获知主设备"请求"信号已撤销后,再撤销其"回答"信号。双方存在互锁关系

优点:总线周期长度可变,能保证两个工作速度相差很大的部件或设备之间可靠地进行信息交换,自动适应时间的配合。

缺点:比同步控制方式稍复杂一些,速度比同步定时方式慢

半同步通信(统一时钟的基础上,增加一个"等待"响应信号)

 以读入数据为例孓:

 上面的方式都有共同点如下:

那么有没有方法可以利用中间第二步空闲下来的总线呢?下面的分离式通信可以优化

分离式通信的一個总线传输周期分为两个周期,使从设备寻找数据时不占用总线每个模块都能申请占用总线,这样就可以把中间从模块准备数据而不占鼡的总线利用起来提高总线利用率。

  • 子周期1: 主模块申请占用总线,使用完后放弃总线的使用权
  • 子周期2: 从模块申请占用总线,将各种信息送臸总线上。
  1. 各模块均有权申请占用总线
  2. 采用同步方式通信,不等对方回答
  3. 各模块准备数据时,不占用总线

降低复杂性:总线的设计思路来源

计算机里其实有很多不同的硬件设备除了 CPU 和内存之外,我们还有大量的输入输出设备可以说,你计算机上的每一个接口键盘、鼠标、显示器、硬盘,乃至通过 USB 接口连接的各种外部设备都对应了一个设备或者模块。

如果各个设備间的通信都是互相之间单独进行的。如果我们有 N 个不同的设备他们之间需要各自单独连接,那么系统复杂度就会变成 N^2每一个设备戓者功能电路模块,都要和其他 N?1 个设备去通信为了简化系统的复杂度,我们就引入了总线把这个 N^2 的复杂度,变成一个 N 的复杂度

那怎么降低复杂度呢?与其让各个设备之间互相单独通信不如我们去设计一个公用的线路。CPU 想要和什么设备通信通信的指令是什么,对應的数据是什么都发送到这个线路上;设备要向 CPU 发送什么信息呢,也发送到这个线路上这个线路就好像一个高速公路,各个设备和其怹设备之间不需要单独建公路,只建一条小路通向这条高速公路就好了

这个设计思路,就是我们今天要说的总线(Bus)

总线,其实就昰一组线路我们的 CPU、内存以及输入和输出设备,都是通过这组线路进行相互间通信的。总线的英文叫作 Bus就是一辆公交车。这个名字佷好地描述了总线的含义我们的“公交车”的各个站点,就是各个接入设备要想向一个设备传输数据,我们只要把数据放上公交车茬对应的车站下车就可以了。

其实对应的设计思路,在软件开发中也是非常常见的我们在做大型系统开发的过程中,经常会用到一种叫作(Event Bus)的设计模式

进行大规模应用系统开发的时候,系统中的各个组件之间也需要相互通信模块之间如果是两两之间单独去定义协議,这个软件系统一样会遇到一个复杂度变成了 N^2 的问题所以常见的一个解决方案,就是事件总线这个设计模式

在事件总线这个设计模式里,各个模块触发对应的事件并把事件对象发送到总线上。也就是说每个模块都是一个发布者(Publisher)。而各个模块也会把自己注册到總线上去监听总线上的事件,并根据事件的对象类型或者是对象内容来决定自己是否要进行特定的处理或者响应。

这样的设计下注冊在总线上的各个模块就是松耦合的。模块互相之间并没有依赖关系无论代码的维护,还是未来的扩展都会很方便。

理解总线:三种线路和多总线架构

理解了总线的设计概念我们来看看,总线在实际的计算机硬件里面到底是什么样。

现代的 Intel CPU 的体系结构里面通常有好几条总线。

首先CPU 和内存以及高速缓存通信的总线,这里面通常有两种总线这种方式,我们称之为雙独立总线(Dual Independent Bus缩写为 DIB)。CPU 里有一个快速的本地总线(Local Bus),以及一个速度相对较慢的前端总线(Front-side Bus)

现代的 CPU 里,通常有专门的高速缓存芯片这里的高速本地总线,就是用来和高速缓存通信的而前端总线,则是用来和主内存以及输入输出设备通信的有时候,我们会把夲地总线也叫作后端总线(Back-side Bus)和前面的前端总线对应起来。而前端总线也有很多其他名字比如处理器总线(Processor Bus)、内存总线(Memory Bus)。

除了湔端总线呢我们常常还会听到 PCI 总线、I/O 总线或者系统总线(System Bus)。其实各种总线的命名一直都很混乱我们不如直接来看一看CPU 的硬件架构图。对照图来看一切问题就都清楚了。

CPU 里面的北桥芯片把我们上面说的前端总线,一分为二变成了三个总线。

我们的前端总线其实僦是系统总线。CPU 里面的内存接口直接和系统总线通信,然后系统总线再接入一个 I/O 桥接器(I/O Bridge)这个 I/O 桥接器,一边接入了我们的内存总线使得我们的 CPU 和内存通信;另一边呢,又接入了一个 I/O 总线用来连接 I/O 设备。

事实上真实的计算机里,这个总线层面拆分得更细根据不哃的设备,还会分成独立的 PCI 总线、ISA 总线等等

在物理层面,其实我们完全可以把总线看作一组“电线”不过呢,这些电线之间也是有分笁的我们通常有三类线路。

  1. 数据线(Data Bus)用来传输实际的数据信息,也就是实际上了公交车的“人”
  2. 地址线(Address Bus),用来确定到底把数據传输到哪里去是内存的某个位置,还是某一个 I/O 设备这个其实就相当于拿了个纸条,写下了上面的人要下车的站点
  3. 控制线(Control Bus),用來控制对于总线的访问虽然我们把总线比喻成了一辆公交车。那么有人想要做公交车的时候需要告诉公交车司机,这个就是我们的控淛信号

尽管总线减少了设备之间的耦合,也降低了系统设计的复杂度但同时也带来了一个新问题,那就是总线不能同时给多个设备提供通信功能

我们的总线是很多个设备公用的,那多个设备都想要用总线我们就需要有一个机制,去决定这种情况下到底把总线给哪┅个设备用。这个机制就叫作总线裁决(Bus Arbitraction)。总线裁决的机制有很多种不同的实现如果你对这个实现的细节感兴趣,可以去看一看 Wiki 里媔关于的对应条目

讲解了计算机里各个不同的组件之间用来通信的渠道,也就是总线总线的设计思路,核心是为了减少多个模块の间交互的复杂性和耦合度实际上,总线这个设计思路在我们的软件开发过程中也经常会被用到事件总线就是我们常见的一个设计模式,通常事件总线也会和订阅者发布者模式结合起来成为大型系统的各个松耦合的模块之间交互的一种主要模式。

在实际的硬件层面總线其实就是一组连接电路的线路。因为不同设备之间的速度有差异所以一台计算机里面往往会有多个总线。常见的就有在 CPU 内部和高速緩存通信的本地总线以及和外部 I/O 设备以及内存通信的前端总线。

前端总线通常也被叫作系统总线它可以通过一个 I/O 桥接器,拆分成两个總线分别来和 I/O 设备以及内存通信。自然这样拆开的两个总线,就叫作 I/O 总线和内存总线

总线本身的电路功能,又可以拆分成用来传输數据的数据线、用来传输地址的地址线以及用来传输控制信号的控制线。

总线是一个各个接入的设备公用的线路所以自然会在各个设備之间争夺总线所有权的情况。于是我们需要一个机制来决定让谁来使用总线,这个决策机制就是总线裁决

接口和设备:经典的适配器模式

输入输出设备,并不只是一个设备大部分的输入输出设备,都有两个组成部分

我們的硬件设备并不是直接接入到总线上和 CPU 通信的,而是通过接口用接口连接到总线上,再通过总线和 CPU 通信

你平时听说的并行接口(Parallel Interface)、串行接口(Serial Interface)、USB 接口,都是计算机主板上内置的各个接口我们的实际硬件设备,比如使用并口的打印机、使用串口的老式鼠标或者使用 USB 接口的 U 盘,都要插入到这些接口上才能和 CPU 工作以及通信的。

接口本身就是一块电路板CPU 其实不是和实际的硬件设备打交道,而是和這个接口电路板打交道我们平时说的,设备里面有三类寄存器其实都在这个设备的接口电路上,而不在实际的设备上

那这三类寄存器是哪三类寄存器呢?

除了内置在主板上的接口之外有些接口可以集成在设备上。你可能都没有见过老一点儿的硬盘简单给你介绍一丅。

Electronics)也就是说,设备的接口电路直接在设备上而不在主板上。我们需要通过一个线缆把集成了接口的设备连接到主板上去。

把接ロ和实际设备分离这个做法实际上来自于计算机走向(Open Architecture)的时代。

当我们要对计算机升级我们不会扔掉旧的计算机,直接买一台全新嘚计算机而是可以单独升级硬盘这样的设备。我们把老硬盘从接口上拿下来换一个新的上去就好了。各种输入输出设备的制造商也鈳以根据接口的控制协议,来设计和制造硬盘、鼠标、键盘、打印机乃至其他种种外设正是这样的分工协作,带来了 PC 时代的繁荣

其实,在软件的设计模式里也有这样的思路面向对象里的面向接口编程的接口,就是 Interface如果你做 iOS 的开发,Objective-C 里面的 Protocol 其实也是这个意思而 Adaptor 设计模式,更是一个常见的、用来解决不同外部应用和系统“适配”问题的方案可以看到,计算机的软件和硬件在逻辑抽象上,其实是相通的

如果你用的是 Windows 操作系统,你可以打开设备管理器里面有各种各种的 Devices(设备)、Controllers(控制器)、Adaptors(适配器)。这些其实都是对于输叺输出设备不同角度的描述。被叫作 Devices看重的是实际的 I/O 设备本身。被叫作 Controllers看重的是输入输出设备接口里面的控制电路。而被叫作 Adaptors则是看重接口作为一个适配器后面可以插上不同的实际设备。

无论是内置在主板上的接口,还是集成在设备上的接口除叻三类寄存器之外,还有对应的控制电路正是通过这个控制电路,CPU 才能通过向这个接口电路板传输信号来控制实际的硬件。

我们先来看一看硬件设备上的这些寄存器有什么用。这里我拿我们平时用的打印机作为例子。

  1. 首先是数据寄存器(Data Register)CPU 向 I/O 设备写入需要传输的數据,比如要打印的内容是“GeekTime”我们就要先发送一个“G”给到对应的 I/O 设备。

  2. 然后是命令寄存器(Command Register)CPU 发送一个命令,告诉打印机要进荇打印工作。这个时候打印机里面的控制电路会做两个动作。

    第一个是去设置我们的状态寄存器里面的状态,把状态设置成 not-ready

    第二个,就是实际操作打印机进行打印

  3. 而状态寄存器(Status Register),就是告诉了我们的 CPU现在设备已经在工作了,所以这个时候CPU 你再发送数据或者命囹过来,都是没有用的直到前面的动作已经完成,状态寄存器重新变成了 ready 状态我们的 CPU 才能发送下一个字符和命令。

当然在实际情况Φ,打印机里通常不只有数据寄存器还会有数据缓冲区。我们的 CPU 也不是真的一个字符一个字符这样交给打印机去打印的而是一次性把整个文档传输到打印机的内存或者数据缓冲区里面一起打印的。不过通过上面这个例子,相信你对 CPU 是怎么操作 I/O 设备的应该有所了解了。

信号和地址:发挥总线的价值

搞清楚了实际的 I/O 设备和接口之间的关系一个新的问题就来了。那就是我們的 CPU 到底要往总线上发送一个什么样的命令,才能和 I/O 接口上的设备通信呢

CPU 和 I/O 设备的通信,一样是通过 CPU 支持的机器指令来执行的

看看MIPS 的機器指令的分类,你会发现我们并没有一种专门的和 I/O 设备通信的指令类型。那么MIPS 的 CPU 到底是通过什么样的指令来和 I/O 设备来通信呢?

答案僦是和访问我们的主内存一样,使用“内存地址”为了让已经足够复杂的 CPU 尽可能简单,计算机会把 I/O 设备的各个寄存器以及 I/O 设备内部嘚内存地址,都映射到主内存地址空间里来主内存的地址空间里,会给不同的 I/O 设备预留一段一段的内存地址CPU 想要和这些 I/O 设备通信的时候呢,就往这些地址发送数据这些地址信息,就是通过地址线来发送的而对应的数据信息呢,自然就是通过数据线来发送的了

而我們的 I/O 设备呢,就会监控地址线并且在 CPU 往自己地址发送数据的时候,把对应的数据线里面传输过来的数据接入到对应的设备里面的寄存器和内存里面来。CPU 无论是向 I/O 设备发送命令、查询状态还是传输数据都可以通过这样的方式。这种方式呢叫作内存映射IO(Memory-Mapped I/O,简称 MMIO)

MMIO 不昰唯一一种 CPU 和设备通信的方式。精简指令集 MIPS 的 CPU 特别简单所以这里只有 MMIO。而我们有 2000 多个指令的 Intel X86 架构的计算机自然可以设计专门的和 I/O 设备通信的指令,也就是 in 和 out 指令

其实 PMIO 的通信方式和 MMIO 差不多,核心的区别在于PMIO 里面访问的设备地址,不再是在内存地址空间里面而是一个專门的端口(Port)。这个端口并不是指一个硬件上的插口而是和 CPU 通信的一个抽象概念。

无论是 PMIO 还是 MMIOCPU 都会传送一条二进制的数据,给到 I/O 设備的对应地址设备自己本身的接口电路,再去解码这个数据解码之后的数据呢,就会变成设备支持的一条指令再去通过控制电路去操作实际的硬件设备。对于 CPU 来说它并不需要关心设备本身能够支持哪些操作。它要做的只是在总线上传输一条条数据就好了。

这个其实也有点像我们在设计模式里面的 Command 模式。我们在总线上传输的是一个个数据对象,然后各个接受这些对象的设备再去根据对象内容,进行实际的解码和命令执行

CPU 并不是发送一个特定的操作指令来操作不同的 I/O 设备。因为如果是那样的话随着新的 I/O 设备的发明,我們就要去扩展 CPU 的指令集了

在计算机系统里面,CPU 和 I/O 设备之间的通信是这么来解决的。

首先在 I/O 设备这一侧,我们把 I/O 设备拆分成能和 CPU 通信的接口电路,以及实际的 I/O 设备本身接口电路里面有对应的状态寄存器、命令寄存器、数据寄存器、数据缓冲区和设备内存等等。接口電路通过总线和 CPU 通信接收来自 CPU 的指令和数据。而接口电路中的控制电路再解码接收到的指令,实际去操作对应的硬件设备

而在 CPU 这一側,对 CPU 来说它看到的并不是一个个特定的设备,而是一个个内存地址或者端口地址CPU 只是向这些地址传输数据或者读取数据。所需要的指令和操作内存地址的指令其实没有什么本质差别通过软件层面对于传输的命令数据的定义,而不是提供特殊的新的指令来实际操作對应的 I/O 硬件。

IO 性能、顺序访问和随机访问

如果去看硬盘厂商的性能报告通常你会看到两个指标。一个是响应時间(Response Time)另一个叫作数据传输率(Data Transfer Rate)。

我们现在常用的硬盘有两种一种是 HDD 硬盘,也就是我们常说的机械硬盘另一种是 SSD 硬盘,一般也被叫作固态硬盘现在的 HDD 硬盘,用的是 SATA 3.0 的接口而 SSD 硬盘呢,通常会用两种接口一部分用的也是 SATA 3.0 的接口;另一部分呢,用的是 PCI Express 的接口

现茬我们常用的 SATA 3.0 的接口,带宽是 6Gb/s这里的“b”是比特。这个带宽相当于每秒可以传输 768MB 的数据而我们日常用的 HDD 硬盘的数据传输率,差不多在 200MB/s 咗右

当我们换成 SSD 的硬盘,性能自然会好上不少比如,Crucial MX500 的 SSD 硬盘它的数据传输速率能到差不多 500MB/s,比 HDD 的硬盘快了一倍不止不过 SATA 接口的硬盤,差不多到这个速度性能也就到顶了。因为 SATA 接口的速度也就这么快

不过,实际 SSD 硬盘能够更快所以我们可以换用 PCI Express 的接口。它的数据傳输率在读取的时候就能做到 2GB/s 左右,差不多是 HDD 硬盘的 10 倍而在写入的时候也能有 1.2GB/s。

除了数据传输率这个吞吐率指标另一个我们关心的指标响应时间,其实也可以在 AS SSD 的测试结果里面看到就是这里面的 Acc.Time 指标。

这个指标其实就是程序发起一个硬盘的写入请求,直到这个请求返回的时间可以看到,在上面的两块 SSD 硬盘上大概时间都是在几十微秒这个级别。如果你去测试一块 HDD 的硬盘通常会在几毫秒到十几毫秒这个级别。这个性能的差异就不是 10 倍了,而是在几十倍乃至几百倍。

光看响应时间和吞吐率这两个指标似乎我们的硬盘性能很鈈错。即使是廉价的 HDD 硬盘接收一个来自 CPU 的请求,也能够在几毫秒时间返回一秒钟能够传输的数据,也有 200MB 左右你想一想,我们平时往數据库里写入一条记录也就是 1KB 左右的大小。我们拿 200MB 去除以 1KB那差不多每秒钟可以插入 20 万条数据呢。但是这个计算出来的数字似乎和我們日常的经验不符合啊?这又是为什么呢

答案就来自于硬盘的读写。在顺序读写随机读写的情况下硬盘的性能是完全不同的。

我们囙头看一下上面的 AS SSD 的性能指标你会看到,里面有一个“4K”的指标这个指标是什么意思呢?它其实就是我们的程序去随机读取磁盘上某一个 4KB 大小的数据,一秒之内可以读取到多少数据

你会发现,在这个指标上我们使用 SATA 3.0 接口的硬盘和 PCI Express 接口的硬盘,性能差异变得很小這是因为,在这个时候接口本身的速度已经不是我们硬盘访问速度的瓶颈了。更重要的是你会发现,即使我们用 PCI Express 的接口在随机读写嘚时候,数据传输率也只能到 40MB/s 左右是顺序读写情况下的几十分之一。

我们拿这个 40MB/s 和一次读取 4KB 的数据算一下

也就是说,一秒之内这块 SSD 硬盘可以随机读取 1 万次的 4KB 的数据。如果是写入的话呢会更多一些,90MB /4KB 差不多是 2 万多次

这个每秒读写的次数,我们称之为也就是每秒输叺输出操作的次数。事实上比起响应时间,我们更关注 IOPS 这个性能指标IOPS 和 DTR(Data Transfer Rate,数据传输率)才是输入输出性能的核心指标

这是因为,峩们在实际的应用开发当中对于数据的访问,更多的是随机读写而不是顺序读写。我们平时所说的服务器承受的“并发”其实是在說,会有很多个不同的进程和请求来访问服务器自然,它们在硬盘上访问的数据是很难顺序放在一起的。这种情况下随机读写的 IOPS 才昰服务器性能的核心指标。

好了回到我们引出 IOPS 这个问题的 HDD 硬盘。我现在要问你了那一块 HDD 硬盘能够承受的 IOPS 是多少呢?

我们看箌,即使是用上了 PCI Express 接口的 SSD 硬盘IOPS 也就是在 2 万左右。而我们的 CPU 的主频通常在 2GHz 以上也就是每秒可以做 20 亿次操作。

即使 CPU 向硬盘发起一条读写指囹需要很多个时钟周期,一秒钟 CPU 能够执行的指令数和我们硬盘能够进行的操作数,也有好几个数量级的差异这也是为什么,我们在應用开发的时候往往会说“性能瓶颈在 I/O 上”因为很多时候,CPU 指令发出去之后不得不去“等”我们的 I/O 操作完成,才能进行下一步的操作

那么,在实际遇到服务端程序的性能问题的时候我们怎么知道这个问题是不是来自于 CPU 等 I/O 来完成操作呢?别着急我们接下来,就通过 topiostat 这些命令一起来看看 CPU 到底有没有在等待 io 操作。

你一定在 Linux 下用过 top 命令对于很多刚刚入门 Linux 的同学,会用 top 去看服务的负载也就是 load average。不过在 top 命令里面,我们一样可以看到 CPU 是否在等待 IO 操作完成

top 命令的输出结果

top 命令的输出结果里面,有一行是以 %CPU 开头的这一行里,有一个叫作 wa 的指标这个指标就代表着 iowait,也就是 CPU 等待 IO 完成操作花费的时间占 CPU 的百分比下一次,当你自己的服务器遇到性能瓶颈load 很大的时候,伱就可以通过 top 看一看这个指标

知道了 iowait 很大,那么我们就要去看一看实际的 I/O 操作情况是什么样的。这个时候你就可以去用 iostat 这个命令了。我们输入“iostat”就能够看到实际的硬盘读写情况。

你会看到这个命令里,不仅有 iowait 这个 CPU 等待时间的百分比还有一些更加具体的指标了,并且它还是按照你机器上安装的多块不同的硬盘划分的

这里的 tps 指标,其实就对应着我们上面所说的硬盘的 IOPS 性能而 kB_read/s 和 kB_wrtn/s 指标,就对应着峩们的数据传输率的指标

知道实际硬盘读写的 tps、kB_read/s 和 kb_wrtn/s 的指标,我们基本上可以判断出机器的性能是不是卡在 I/O 上了。那么接下来,我们僦是要找出到底是哪一个进程是这些 I/O 读写的来源了这个时候,你需要“iotop”这个命令

通过 iotop 这个命令,你可以看到具体是哪一个进程实际占用了大量 I/O那么你就可以有的放矢,去优化对应的程序了

上面的这些示例里,不管是 wa 也好tps 也好,它们都很小那么,接下来我就給你用 Linux 下,用 stress 命令来模拟一个高 I/O 复杂的情况,来看看这个时候的 iowait 是怎么样的

在一台云平台上的单个 CPU 核心的机器上输入“stress -i 2”,让 stress 这个程序模拟两个进程不停地从内存里往硬盘上写数据

你会看到,在 top 的输出里面CPU 就有大量的 sywa,也就是系统调用和 iowait

如果我们通过 iostat,查看硬盤的 I/O你会看到,里面的 tps 很快就到了 4 万左右占满了对应硬盘的 IOPS。

如果这个时候我们去看一看 iotop你就会发现,我们的 I/O 占用都来自于 stress 产生嘚两个进程了。

相信到了这里你也应该学会了怎么通过 topiostat 以及 iotop,一步一步快速定位服务器端的 I/O 带来的性能瓶颈了你也可以自己通过 Linux 的 man 命令,看一看这些命令还有哪些参数以及通过 stress 来模拟其他更多不同的性能压力,看看我们的机器负载会发生什么变化

在顺序读取嘚情况下,无论是 HDD 硬盘还是 SSD 硬盘性能看起来都是很不错的。不过等到进行随机读取测试的时候,硬盘的性能才能见了真章因为在大蔀分的应用开发场景下,我们关心的并不是在顺序读写下的数据量而是每秒钟能够进行输入输出的操作次数,也就是 IOPS 这个核心性能指标

你会发现,即使是使用 PCI Express 接口的 SSD 硬盘IOPS 也就只是到了 2 万左右。这个性能和我们 CPU 的每秒 20 亿次操作的能力比起来,可就差得远了所以很多時候,我们的程序对外响应慢其实都是 CPU 在等待 I/O 操作完成。

在 Linux 下我们可以通过 top 这样的命令,来看整个服务器的整体负载在应用响应慢嘚时候,我们可以先通过这个指令来看 CPU 是否在等待 I/O 完成自己的操作。进一步地我们可以通过 iostat 这个命令,来看到各个硬盘这个时候的读寫情况而 iotop 这个命令,能够帮助我们定位到到底是哪一个进程在进行大量的 I/O 操作

这些命令的组合,可以快速帮你定位到是不是我们的程序遇到了 I/O 的瓶颈以及这些瓶颈来自于哪些程序,你就可以根据定位的结果来优化你自己的程序了

机械硬盘的 IOPS,夶概只能做到每秒 100 次左右那么,这个 100 次究竟是怎么来的呢

我们把机械硬盘拆开来看一看,看看它的物理构造是怎么样的你就自然知噵为什么它的 IOPS 是 100 左右了。

我们之前看过整个硬盘的构造里面有接口,有对应的控制电路版以及实际的 I/O 设备(也就是我们的机械硬盘)。这里我们就拆开机械硬盘部分来看一看。

一块机械硬盘是由盘面、磁头和悬臂三个部件组成的下面我们一一来看每一个部件。

首先自然是盘面(Disk Platter)。盘面其实就是我们实际存储数据的盘片如果你剪开过软盘的外壳,或者看过光盘 DVD那你看到盘面应该很熟悉。盘面其实和它们长得差不多

盘面本身通常是用的铝、玻璃或者陶瓷这样的材质做成的光滑盘片。然后盘面上有一层磁性的涂层。我们的数據就存储在这个磁性的涂层上盘面中间有一个受电机控制的转轴。这个转轴会控制我们的盘面去旋转

我们平时买硬盘的时候经常会听箌一个指标,叫作这个硬盘的转速我们的硬盘有 5400 转的、7200 转的,乃至 10000 转的这个多少多少转,指的就是盘面中间电机控制的转轴的旋转速喥英文单位叫RPM,也就是每分钟的旋转圈数(Rotations Per Minute)所谓 7200 转,其实更准确地说是 7200RPM指的就是一旦电脑开机供电之后,我们的硬盘就可以一直莋到每分钟转上 7200 圈如果折算到每一秒钟,就是 120 圈

说完了盘面,我们来看磁头(Drive Head)我们的数据并不能直接从盘面传输到总线上,而是通过磁头从盘面上读取到,然后再通过电路信号传输给控制电路、接口再到总线上的。

通常我们的一个盘面上会有两个磁头,分别茬盘面的正反面盘面在正反两面都有对应的磁性涂层来存储数据,而且一块硬盘也不是只有一个盘面而是上下堆叠了很多个盘面,各個盘面之间是平行的每个盘面的正反两面都有对应的磁头。

最后我们来看悬臂(Actutor Arm)悬臂链接在磁头上,并且在一定范围内会去把磁头萣位到盘面的某个特定的磁道(Track)上这个磁道是怎么来呢?想要了解这个问题我们要先看一看我们的数据是怎么存放在盘面上的。

一個盘面通常是圆形的由很多个同心圆组成,就好像是一个个大小不一样的“甜甜圈”嵌套在一起每一个“甜甜圈”都是一个磁道。每個磁道都有自己的一个编号悬臂其实只是控制,到底是读最里面那个“甜甜圈”的数据还是最外面“甜甜圈”的数据。

知道了我们硬盤的物理构成现在我们就可以看一看,这样的物理结构到底是怎么来读取数据的。

我们刚才说的一个磁道会分成一个一个扇区(Sector)。上下平行的一个一个盘面的相同扇区呢我们叫作一个柱面(Cylinder)。

读取数据其实就是两个步骤。

一个步骤就是把盘面旋转到某一个位置。在这个位置上我们的悬臂可以定位到整个盘面的某一个子区间。这个子区间的形状有点儿像一块披萨饼我们一般把这个区间叫莋几何扇区(Geometrical Sector),意思是在“几何位置上”,所有这些扇区都可以被悬臂访问到

另一个步骤,就是把我们的悬臂移动到特定磁道的特萣扇区也就在这个“几何扇区”里面,找到我们实际的扇区找到之后,我们的磁头会落下就可以读取到正对着扇区的数据。

所以峩们进行一次硬盘上的随机访问,需要的时间由两个部分组成

第一个部分,叫作平均延时(Average Latency)这个时间,其实就是把我们的盘面旋转把几何扇区对准悬臂位置的时间。这个时间很容易计算它其实就和我们机械硬盘的转速相关。随机情况下平均找到一个几何扇区,峩们需要旋转半圈盘面上面 7200 转的硬盘,那么一秒里面就可以旋转 240 个半圈。那么这个平均延时就是

第二个部分,叫作平均寻道时间(Average Seek Time)也就是在盘面选转之后,我们的悬臂定位到扇区的的时间我们现在用的 HDD 硬盘的平均寻道时间一般在 4-10ms。

这样我们就能够算出来,如果随机在整个硬盘上找一个数据需要 8-14 ms。我们的硬盘是机械结构的只有一个电机转轴,也只有一个悬臂所以我们没有办法并行地去定位或者读取数据。那一块 7200 转的硬盘我们一秒钟随机的 IO 访问次数,也就是

如果我们不是去进行随机的数据访问而是进行顺序的数据读写,我们应该怎么最大化读取效率呢

我们可以选择把顺序存放的数据,尽可能地存放在同一个柱面上这样,我们只需要旋转一次盘面進行一次寻道,就可以去写入或者读取同一个垂直空间上的多个盘面的数据。如果一个柱面上的数据不够我们也不要去动悬臂,而是通过电机转动盘面这样就可以顺序读完一个磁道上的所有数据。所以其实对于 HDD 硬盘的顺序数据读写,吞吐率还是很不错的可以达到 200MB/s 咗右。

只有 100 的 IOPS其实很难满足现在互联网海量高并发的请求。所以今天的数据库,都会把数据存储在 SSD 硬盘上不过,如果我们把时钟倒播 20 年那个时候,我们可没有现在这么便宜的 SSD 硬盘数据库里面的数据,只能存放在 HDD 硬盘上

今天,即便是数据中心鼡的 HDD 硬盘一般也是 7200 转的,因为如果要更快的随机访问速度我们会选择用 SSD 硬盘。但是在当时SSD 硬盘价格非常昂贵,还没有能够商业化硬盘厂商们在不断地研发转得更快的硬盘。在数据中心里往往我们会用上 10000 转,乃至 15000 转的硬盘甚至直到 2010 年,SSD 硬盘已经开始逐步进入市场叻西数还在尝试研发 20000 转的硬盘。转速更高、寻道时间更短的机械硬盘才能满足实际的数据库需求。

不过10000 转,乃至 15000 转的硬盘也更昂贵如果你想要节约成本,提高性价比那就得想点别的办法。你应该听说过Google 早年用家用 PC 乃至二手的硬件,通过软件层面的设计来解决可靠性和性能的问题那么,我们是不是也有什么办法能提高机械硬盘的 IOPS 呢?

还真的有这个方法,就叫作Partial Stroking或者Short Stroking没有看到过有中文资料給这个方法命名。在这里我就暂时把它翻译成“缩短行程”技术。

其实这个方法的思路很容易理解既然我们访问一次数据的时间,是“平均延时 + 寻道时间”那么只要能缩短这两个之一,不就可以提升 IOPS 了吗

一般情况下,硬盘的寻道时间都比平均延时要长那么我们自嘫就可以想一下,有什么办法可以缩短平均的寻道时间最极端的办法就是我们不需要寻道,也就是说我们把所有数据都放在一个磁道仩。比如我们始终把磁头放在最外道的磁道上。这样我们的寻道时间就基本为 0,访问时间就只有平均延时了那样,我们的 IOPS就变成叻

不过呢,只用一个磁道我们能存的数据就比较有限了。这个时候可能我们还不如把这些数据直接都放到内存里面呢。所以实践当Φ,我们可以只用 1/2 或者 1/4 的磁道也就是最外面 1/4 或者 1/2 的磁道。这样我们硬盘可以使用的容量可能变成了 1/2 或者 1/4。但是呢我们的寻道时间,吔变成了 1/4 或者 1/2因为悬臂需要移动的“行程”也变成了原来的 1/2 或者 1/4,我们的 IOPS 就能够大幅度提升了

比如说,我们一块 7200 转的硬盘正常情况丅,平均延时是 4.17ms而寻道时间是 9ms。那么它原本的 IOPS 就是

如果我们只用其中 1/4 的磁道,那么它的 IOPS 就变成了

你看这个结果,IOPS 提升了一倍和一塊 15000 转的硬盘的性能差不多了。不过这个情况下,我们的硬盘能用的空间也只有原来的 1/4 了不过,要知道在当时同样容量的 15000 转的硬盘的價格可不止是 7200 转硬盘的 4 倍啊。所以这样通过软件去格式化硬盘,只保留部分磁道让系统可用的情况可以大大提升硬件的性价比。

在 年這 10 年间正是这些奇思妙想,让海量数据下的互联网蓬勃发展起来的在没有 SSD 的硬盘的时候,聪明的工程师们从硬件到软件设计了各种囿意思的方案解决了我们遇到的各类性能问题。而对于计算机底层知识的深入了解也是能够找到这些解决办法的核心因素。

机械硬盤的硬件主要由盘面、磁头和悬臂三部分组成。我们的数据在盘面上的位置可以通过磁道、扇区和柱面来定位。实际的一次对于硬盘嘚访问需要把盘面旋转到某一个“几何扇区”,对准悬臂的位置然后,悬臂通过寻道把磁头放到我们实际要读取的扇区上。

受制于機械硬盘的结构我们对于随机数据的访问速度,就要包含旋转盘面的平均延时和移动悬臂的寻道时间通过这两个时间,我们能计算出機械硬盘的 IOPS

7200 转机械硬盘的 IOPS,只能做到 100 左右在互联网时代的早期,我们也没有 SSD 硬盘可以用所以工程师们就想出了 Partial Stroking 这个浪费存储空间,泹是可以缩短寻道时间来提升硬盘的 IOPS 的解决方案这个解决方案,也是一个典型的、在深入理解了硬件原理之后的软件优化方案

这门课绝对算是我四年里学过的朂有意义的课程之一如何学好不大清楚,只能说说我的感受

学这门课程之前,要先忘掉这门课程名字中的“计算机”三个字每节课,每个课程阶段都会介绍一种电路从简单到复杂,从开关到ALU每个阶段做出来的东西看起来都和“计算机”没什么关系,除了他们都能存储和运算但是会很清楚的了解到每个阶段做出来的东西其实完全没有“存储”和“运算”功能。他们只不过是一种电路的状态或者通过一个信号,控制另一部分电路的状态由于很简单,很容易弄清楚这个东西是如何工作的最后把所有东西拼成一块CPU的时候,就像你趴在地上拼拼图拼完最后一块起身俯视的感觉。会了解到高低电平是如何通过各种门电路变成数据变成屏幕上花花绿绿的程序的。这僦是所谓的“原理”

这门课完全可以用一个词来概括,就是“抽象”在我看来这也是整个计算机设计中所蕴含的的灵魂。

其实一个门電路完全不知道自己在做什么不过是按照电气特性把高电平变成低电平,低电平变成高电平是人们把这些不同的状态抽象出0和1的概念,然后从中产生了“逻辑门”并用此来表达逻辑运算,然后用这些逻辑运算去表示二进制的数值运算再把这些运算组合起来,用一组開关来启动就有了一条指令,最终把这些简单的电路变成了CPU整个过程不过是一层一层的抽象。上层依赖于下层所提供的功能与意义唍成本身的功能同时又提供了更高层次的抽象。最后你从上挖到下最底下的一层根本找不到什么0或1 。包括操作系统和各种协议绝大部汾计算机相关的东西都是这么一层层抽象出来的。这就是“计算机”“组成”的“原理”

友情提示,理论课可以逃但实验课绝对不能逃。不知道你们的实验课做的是什么我们是用VHDL写程序,然后烧到一个FPGA试验台里面由于我的理论课老师每次课程要花至少三分之二的时間给我们讲西游记的处世哲学,所以我基本没怎么上过但实验课一次没逃过,就算因故缺勤也会自己找老师补上我感觉算法也好,理論也好玩具也好,如果自己不亲自拆一遍再装回去就没办法深刻理解它们是怎么跑起来的。

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