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在复杂的通讯、终端和计算机产品不断更新的今天硬件产品的流程划分越来越细。即便是小的公司(部门、研究所)做这些项目(板、卡)都会有专门PCB工程师做layout。而渐渐的这门生意(技术)也催生出PCB的公司专门从事PCB绘制业务,而且越来越专業(内部的分工也极细)
硬件工程师渐渐成为原理图工程师,本人便沦落至此但好歹我还能捅鼓两下PCB工具软件,很多硬件工程师这部汾也不熟悉了分工的细化,渐渐衍生出能力的退化退化成啥了呢?退化成很多布线规则、规范都不懂而很多PCB工程师懂的比硬件工程師多。但是毕竟PCB工程师更偏向于生产制造可能对电路原理问题吵架并没有太多底气;另外一方面,生产实际有很多说不清楚的东西比洳生产误差,或者是电路的一些干扰需要实践验证的东西,结果是PCB公司面对客户经常说:
同时也就催生了一批敢于嚣张甩锅的硬件工程师,同时也恶心到了一批加班加点的PCB工程师
所以你看到很多PCB公司SI的文章都是在洗脑的同时哀求着“别折腾了!”
“咱们PCB最后就是几个主要要求,一、没有DRC告警我们就让他连warning都没有。二、差分对等长1mil反正跟等长相关的我们就是1mil。原因嘛省的软件的和我们扯皮。”大先生生性软弱颇以为然,连连称是这年头,讲理特别费劲不如我们甩锅来的痛快,软件要吵的架就让PCB的绕去吧。
大先生曾和协作單位合作看了我们显存2片DDR的布线后,对我们使用T拓扑提出质疑说我这个部分没有按照DDR3 Fly-by的规范来。大先生生性软弱不敢言语。而肚子裏问:
X8的各组差分对是否需要设置组内等长一下也把大先生蒙住了,印象中从来没有提过这个要求PCB工程师告诉我“很多客户提这个要求。”大先生生性软弱言曰
“可能是有一些自研芯片设计有缺陷,遂对PCB布线要求严格”
而自己回家暗暗查阅PCIe规范,PCIe规范专门为了板级咘线方面要求PCIe接口具有“可逆序差分对PN可调换,多组差分线可不等长的要求而在PCIe初始化训练专门有一个步骤,去校准多对线不等长叫De-skew”。
BGA下或通过一些连接器孔的线产生neck为什么允许阻抗不连续点,或者为什么不允许原因为何?阻抗不连续点能允许多少长度线路出現
过孔的stub到底对哪些线路产生影响,什么时候需要背钻
并行走线最关注哪些因素。高速串行走线特别高速的,比如25G的最要命的是哪些因素
比如这个问题“阻抗不连续点能允许多少长度线路出现?”答案是看我的笔记就好啦原来有条件能抵消
原理图:可以添加单引脚的接插件放置后可以修改其封装。基礎库有接插件的库
PCB:单PCB可以手动添加单层焊盘并连接导线。
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